Basavaraj (R) Chikkanagoudar-ASIC Design Verification Engineer
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Erfahrungen
ASIC Verification Engineer
Ogheri Consulting GmbH
- Eine stark parameterisierte UVM-Umgebung aufgebaut und konfiguriert, um ein AMBA-APB-Subsystem zu validieren.
- Virtuelle Sequencer entwickelt, um synchronisierte, parallele Master-Slave-Sequenzen auszuführen und so eine genaue Peripherie-Adressdekodierung und das Protocol Handshake sicherzustellen.
- Methoden: UVM, Constrained Random Verification
- Tools: Cadence Xcelium, SimVision
Firmware Developer
MINRES Technologies
- Architekturumgebung & Verification Triage: Eine stabile RISC-V-Verification-DevContainer-Umgebung aufgebaut und automatisiert, indem ich den DBT-RISE-RISCV-Simulator mit seinen CMake-Abhängigkeiten kompiliert habe, und eine tiefe Python-Debugging-Pipeline eingerichtet, um einen automatisierten Fehler in einem 'I'-Instruction-Set-Test bis auf eine Abweichung in der Shell-Umgebung zurückzuverfolgen.
RISC-V Core implementation & evaluation of SBST
- Ein Single-Cycle-RISC-V-RV32I_Zicsr-Design implementiert
- Den Core mit RISCOF-Plugins getestet
- CLIC-Integration durchgeführt und Assembly-Testfälle geschrieben, um den CSR-Zugriff, Interrupt-Priorität und level-sensitive Interrupt-Logik zu verifizieren.
- SBST auf einem fehlerfreien und einem fehlerinjizierten CLIC bewertet.
Research Assistant
Forschungszentrum Informatik (FZI)
- Umfassende Cocotb-basierte Testbenches entwickelt, um verschiedene Speicherarchitekturen für (SPRAM, DPRAM, QPRAM, URAM) zu verifizieren, indem ich randomisierte Transaktionen, funktionale Verifikation über Scoreboards und parallele Stimulus-Erzeugung eingebaut habe.
- Die Funktionalität des Leaky Integrate-and-Fire (LIF) Neuronenmodells verifiziert, indem ich mehrere Cocotb-Testcases implementiert habe – für Einzelberechnungen, Spike-Erzeugung, Idle-Logik und gepipeltes Eingabeverhalten.
Sr. ASIC Digital Engineer
Synopsys
- FPGA-Prototyping: High-Speed-Ethernet-Designs (100G/400G-Controller) und Time-Sensitive-Networking-Features auf die HAPS-100-Plattform (Xilinx Virtex Ultrascale+ FPGA) portiert und prototypisiert
- Verifikation & Testing: Pre-Silicon-Verification, funktionale Tests und Performance-Benchmarking für die Hyper-DMA-(HDMA)-Funktion durchgeführt
- System Validation: Device-Driver und Anwendungscode debuggt, um eine reibungslose Hardware-Software-Integration sicherzustellen.
ASIC Digital Engineer
Synopsys
- RTL-Design & IP-Integration: Ethernet-MAC/PCS-IPs (1G/10G/40G) mit PCIe-, AMBA-(AXI/APB)-Protokollen, Marvell-1G-Phys und Xilinx-Transceivern (GTH/GTY) integriert, um Ethernet-Lösungen aufzubauen.
- FPGA-Prototyping & Flow: Den kompletten FPGA-Implementierungs-Flow betreut – inklusive Synthesis, Place & Route und Timing Closure –, um Kundendesigns auf Xilinx Virtex Ultrascale (HAPS-80)-Plattformen zu validieren.
- Verifikation & Board-Bring-up: Umfangreiche Testpläne und Testbenches für die Pre-Silicon-Verifikation entwickelt, Software-Driver-Tests ausgeführt und das Hardware-Board-Bring-up durchgeführt.
- Tools: VCS, Protocompiler, Vivado, Synplify
Praktikant
Synopsys
- Einblick in die Linux-Umgebung und Scripting erhalten
- Mit der Prototyping-Umgebung, Clocking & Reset, dem Schreiben von Timing-Constraints und FPGA-Pin-Mapping vertraut geworden
Erkennung von Pflanzenkrankheiten
- Erkennung von 15 Pflanzenkrankheiten bei 3 Pflanzenarten
- CNN-Technik wird eingesetzt, um Krankheiten zu erkennen
- Das Modell ist darauf trainiert, gesunde und kranke Pflanzen zu erkennen
RFID-basiertes Verkaufsautomatensystem
- Automatisches Verkaufsautomatensystem auf Basis von Sensoren
- RFID-basiertes Bezahlsystem
Branchenerfahrung
Sieh, in welchen Branchen dieser Freelancer den Großteil seiner beruflichen Laufbahn verbracht hat.
Erfahren in Informationstechnologie (IT), Fertigung, Landwirtschaft und Einzelhandel.
Erfahrung nach Fachbereich
Zeigt, in welchen Abteilungen und Funktionen dieser Freelancer am meisten mitgewirkt hat.
Erfahren in Informationstechnologie (IT), Produktentwicklung, Qualitätssicherung und Forschung und Entwicklung (F&E).
Zusammenfassung
FPGA Prototyping Engineer mit 4 Jahren Erfahrung in der VLSI-Branche, aktuell im M.Sc. Embedded Systems mit Schwerpunkt Hardware-Software-Co-Design. Ich nutze meinen starken Hintergrund in Pre-Silicon Verification, Hardware Bring-up und komplexer IP-Integration, um in die Design Verification zu wechseln. Ich bin sehr motiviert für Innovation und möchte mit meiner Arbeit zu modernen Projekten beitragen und technologische Grenzen verschieben.
Fähigkeiten
- Verilog
- System Verilog
- C
- Python
- Uvm
- Cocotb
- Ethernet (1g-400g)
- Amba (Axi, Apb)
- Pcie
- Xilinx Ips
- Synopsys Vcs
- Protocompiler
- Xilinx Vivado
- Cadence Xcelium
- Xilinx Virtex Ultrascale Und Ultrascale+ (Haps-80 Und Haps-100 Plattformen)
Sprachen
Ausbildung
Albert-Ludwigs-Universität Freiburg
M.Sc. · Embedded Systems · Freiburg im Breisgau, Deutschland · 1.4
BMS College of Engineering
Bachelor of Engineering · Electronics & Communication · Bengaluru, Indien · 1.4
Zertifikate & Bescheinigungen
Accelerated Verification with UVM
Python CocoTB Fundamentals, OOPS
Udemy
System Verilog Essentials
Udemy
SystemVerilog for Design and Verification
Cadence Design Systems
VLSI CAD Part 1: Logic
University of Illinois, Coursera
Verification with System Verilog and UVM
VeriKwest, Bengaluru
Statistiken
Erfahrung
Globale Erfahrung
Fachkenntnisse
Qualifikationen
Profil
Häufig gestellte Fragen
Du hast Fragen? Hier findest du mehr.
Basavaraj ist in Freiburg im Breisgau, Deutschland ansässig.
Basavaraj spricht folgende Sprachen: Englisch (Verhandlungssicher), Kannada (Verhandlungssicher), Deutsch (Grundkenntnisse).
Basavaraj hat mindestens 6 Jahre Erfahrung. In dieser Zeit hat Basavaraj in mindestens 9 verschiedenen Rollen und für 4 verschiedene Firmen gearbeitet. Die durchschnittliche Dauer der einzelnen Projekte beträgt 1 Jahr und 8 Monate. Beachten Sie, dass Basavaraj möglicherweise nicht alle Erfahrungen geteilt hat und tatsächlich mehr Erfahrung hat.
Basierend auf der jüngsten Erfahrung wäre Basavaraj gut geeignet für Rollen wie: ASIC Verification Engineer, Firmware Developer, RISC-V Core implementation & evaluation of SBST.
Die neueste Position von Basavaraj ist ASIC Verification Engineer bei Ogheri Consulting GmbH.
In den letzten Jahren hat Basavaraj für Ogheri Consulting GmbH, MINRES Technologies, Forschungszentrum Informatik (FZI) und Synopsys gearbeitet.
Basavaraj hat die meiste Erfahrung in Industrien wie Informationstechnologie (IT), Landwirtschaft und Einzelhandel. Basavaraj hat auch etwas Erfahrung in Fertigung.
Basavaraj hat die meiste Erfahrung in Bereichen wie Informationstechnologie (IT), Produktentwicklung und Qualitätssicherung. Basavaraj hat auch etwas Erfahrung in Forschung und Entwicklung (F&E).
Basavaraj hat kürzlich in Industrien wie Informationstechnologie (IT) und Fertigung gearbeitet.
Basavaraj hat kürzlich in Bereichen wie Qualitätssicherung, Informationstechnologie (IT) und Produktentwicklung gearbeitet.
Basavaraj hat einen Master in Embedded Systems von Albert-Ludwigs-Universität Freiburg und einen Bachelor in Electronics & Communication von BMS College of Engineering.
Basavaraj hat 6 Zertifikate. Darunter sind: Accelerated Verification with UVM, Python CocoTB Fundamentals, OOPS und System Verilog Essentials.
Basavaraj wird ab Oktober 2026 vollzeit verfügbar sein.
Tagessatzverteilung
Die angegebenen Tagessätze entsprechen der typischen Marktspanne für Freelancer in dieser Position, basierend auf aktuellen Projekten auf unserer Plattform.
Durchschnittlicher Tagessatz für ähnliche Positionen
Die Tagessätze basieren auf aktuellen Projekten und enthalten keine FRATCH-Marge.
Der durchschnittliche Tagessatz ist der Mittelwert aller Tagessätze aus aktuellen Verträgen vergleichbarer Freelancer auf unserer Plattform.
Der Median-Tagessatz ist der mittlere Wert aller Tagessätze – die Hälfte der vergleichbaren Freelancer verlangt weniger, die andere Hälfte mehr. Anders als der Durchschnitt wird er von Ausreißern kaum beeinflusst.
Berechnet auf Basis der Tagessätze unserer Freelancer, Stand 30 Aug 2026. Die tatsächlichen Tagessätze können je nach Dienstalter, Erfahrung, Fachkenntnissen, Projektkomplexität und Auftragsdauer variieren.
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